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Microchip digital SY75707TWL-TR
de interfazconvertidorconversor de nivel

Microchip digital - SY75707TWL-TR - Atmel - de interfaz / convertidor / conversor de nivel
Microchip digital - SY75707TWL-TR - Atmel - de interfaz / convertidor / conversor de nivel
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Características

Especificaciones
digital, de interfaz, convertidor
Otras características
conversor de nivel

Descripción

Resumen del producto
SY75707 es un traductor de entrada diferencial a dos salidas LVCMOS con jitter aditivo muy bajo y rango de temperatura extendido. Acepta VDDIN de 1,8 V a 3,3 V y traduce a VDDO de 1,2 V a 1,8 V. Empaquetado en un VDFN ultra-compacto de 8 patillas (1,4 mm × 1,6 mm), integra resistencia serie de 50 Ω en las salidas LVCMOS para conducir directamente líneas de transmisión de 50 Ω.

Características principales
  • Entrada diferencial HCSL / LVPECL / LVDS
  • Dos salidas LVCMOS con resistencia serie de 50 Ω integrada
  • Traducción de tensión: VDDIN 1,8–3,3 V → VDDO 1,2–1,8 V
  • Jitter aditivo: 32 fs típico (banda 12 kHz–20 MHz a 156,25 MHz)
  • Retardo de propagación típico: 1,2 ns
  • Frecuencia máxima de salida (fMAX): 250 MHz
  • Disponible en encapsulado VDFN ultra-compacto de 8 patillas (1,4 mm × 1,6 mm)

Paramétricos / Tabla
Entrada: HCSL / LVPECL / LVDS
Frecuencia de salida (Max) (GHz): 0,25
Retardo de propagación máx. (ps): 2300
OE: Sí
Salida: LVCMOS
Tensión de alimentación (VDDIN): 1,8 V a 3,3 V
Tensión de salida (VDDO): 1,2 V a 1,8 V

Descripción
SY75707 está diseñado para traducir señales de reloj o datos diferenciales a salidas LVCMOS mientras minimiza el jitter aditivo y mantiene un factor de forma reducido, bajo consumo y coste contenido. La resistencia serie de 50 Ω integrada permite conducir directamente líneas de transmisión estándar sin componentes serie externos.

Aplicaciones típicas
  • Traducción de reloj diferencial a LVCMOS single-ended
  • Distribución de reloj de alto rendimiento en sistemas de factor de forma reducido
  • Receptores/transmisores de comunicaciones de alta velocidad que requieren jitter aditivo muy bajo

Especificaciones técnicas
  • Jitter aditivo: 32 fs típico (12 kHz–20 MHz a 156,25 MHz)
  • Retardo de propagación: ~1,2 ns típico
  • Frecuencia máxima de salida (fMAX): 250 MHz
  • Entradas soportadas: HCSL, LVPECL, LVDS
  • Salidas: dos LVCMOS con resistencia serie de 50 Ω integrada
  • Alimentación de entrada (VDDIN): 1,8 V a 3,3 V
  • Alimentación de salida (VDDO): 1,2 V a 1,8 V
  • Encapsulado: VDFN ultra-compacto de 8 patillas (1,4 mm × 1,6 mm)
  • Rango de temperatura de funcionamiento: extendido (ver hoja de datos)

Catálogos

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* Los precios no incluyen impuestos, gastos de entrega ni derechos de exportación. Tampoco incluyen gastos de instalación o de puesta en marcha. Los precios se dan a título indicativo y pueden cambiar en función del país, del coste de las materias primas y de los tipos de cambio.
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